项目描述 ：
Trabalho para disciplina Projeto de Circuitos Integrados Digitais. Processador de 6 instruções 8 bits em System Verilog implementado em placa FPGA.

高级语言： SystemVerilog

项目主页：

项目地址: git://github.com/Daniel-Pinheiro/Processador6Instr-FPGA.git

创建时间： 2016-11-29T23:14:04Z
项目社区：https://github.com/Daniel-Pinheiro/Processador6Instr-FPGA
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