项目描述 ：
Wojciech's hardware bits and Verilog snippets.

高级语言： Verilog

项目主页：

项目地址: git://github.com/wkoszek/hardware.git

创建时间： 2015-04-27T06:47:59Z
项目社区：https://github.com/wkoszek/hardware
开源协议：BSD 2-Clause "Simplified" License
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