项目描述 ：
Direct digital frequency synthesizer in Verilog and VHDL.

高级语言： VHDL

项目主页：

项目地址: git://github.com/urbanij/DDFS.git

创建时间： 2018-05-28T08:29:16Z
项目社区：https://github.com/urbanij/DDFS
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